八個(gè)低RDSon數(shù)據(jù)輸出（25°C時(shí)IO=1A時(shí)為0.5Ω，VCC=5V±5%）

8位串行輸入數(shù)據(jù)（SPI）

8位串行診斷輸出

過(guò)載和開(kāi)路條件

輸出短路保護(hù)

CHIPENABLESELECTFUNCTION（低電平有效）

每個(gè)輸出的內(nèi)部35V夾持

與另一個(gè)八進(jìn)制級(jí)聯(lián)

低靜態(tài)電流（最大10mA）

組件電源SO20

說(shuō)明

L9822N是一個(gè)八進(jìn)制低壓側(cè)電磁閥驅(qū)動(dòng)器重點(diǎn)研究了多功率BCD技術(shù)適用于車(chē)燈、繼電器和電磁閥移動(dòng)環(huán)境。DMOS的產(chǎn)量超過(guò)了L9822N具有非常低的功耗。數(shù)據(jù)通過(guò)串行方式傳輸?shù)皆O(shè)備串行外圍接口（SPI）協(xié)議。L9822N具有輸出狀態(tài)監(jiān)視功能功能。

管腳說(shuō)明

邏輯電源電壓-標(biāo)稱(chēng)5V

接地

設(shè)備地面。這個(gè)邏輯電路和功率輸出級(jí)的接地裝置。

重置

異步復(fù)位L9822NSP內(nèi)部的輸出級(jí)、并行鎖存器和移位寄存器。此引腳處于低激活狀態(tài)，不能保持浮動(dòng)狀態(tài)。通電清除功能可以通過(guò)一個(gè)外部電阻器將該引腳連接到VCC用外部電容器接地。總工程師芯片啟用。數(shù)據(jù)從移位寄存器傳輸?shù)叫盘?hào)上升沿的輸出端。該信號(hào)的下降沿設(shè)置移位寄存器輸出電壓檢測(cè)位來(lái)自輸出級(jí)。SO引腳的輸出驅(qū)動(dòng)器是此引腳低時(shí)啟用。所以串行輸出。此引腳是移位寄存器，當(dāng)CE高時(shí)，它是三態(tài)的。A此管腳上的數(shù)據(jù)位為高表示特殊輸出為高。該引腳上的數(shù)據(jù)位低表示輸出低。將串行輸出位與前一位進(jìn)行比較串行輸入位外部微控制器執(zhí)行L9822提供的診斷數(shù)據(jù)。

硅

串行輸入。該引腳是串行數(shù)據(jù)輸入。高潮在此Pin上，將編程一個(gè)ParticularRoutPuttoBeoff，低氣壓會(huì)打開(kāi)它。

串行時(shí)鐘。該引腳為移位寄存器計(jì)時(shí)。新的所以數(shù)據(jù)會(huì)出現(xiàn)在這個(gè)引腳的每一個(gè)上升沿上新的數(shù)據(jù)將被鎖存到每一slk's fal ling edge到移位寄存器中。

輸出00-07

電源輸出引腳輸入和輸出位與07位相對(duì)應(yīng)，首先通過(guò)SPI接收公共汽車(chē)和00是最后一班。輸出具有電流限制和用于故障指示和保護(hù)的電壓感應(yīng)功能。這些輸出的額定負(fù)載電流是500毫安。輸出也有板上夾具設(shè)置為36V左右，用于感應(yīng)負(fù)載再循環(huán)電流。

電氣特性（VCC=5V±5%。Tj=–40至125°C；除非另有規(guī)定）

功能描述

L9822NDMOS輸出的工作功率很低設(shè)備功能環(huán)，8個(gè)1ΩRDSON DMOS驅(qū)動(dòng)程序輸出級(jí)有瞬態(tài)保護(hù)電路。每個(gè)信道由輸出鎖存器和公共復(fù)位線(xiàn)獨(dú)立控制所有八個(gè)輸出。驅(qū)動(dòng)器的飽和度低短路保護(hù)和直流電以及電磁閥、燈和繼電器等電阻負(fù)載。數(shù)據(jù)通過(guò)這些串行接口（SPI）傳輸?shù)皆O(shè)備協(xié)議。那個(gè)電路通過(guò)串行輸入接收8位串行數(shù)據(jù)（SI）存儲(chǔ)在內(nèi)部寄存器中以控制輸出驅(qū)動(dòng)程序。串行輸出（SO）提供8表示電壓水平的診斷數(shù)據(jù)位在驅(qū)動(dòng)器輸出端。這使得微處理器診斷輸出驅(qū)動(dòng)器的狀況。

輸出飽和電壓由不飽和狀態(tài)的比較器能夠通過(guò)斷層打開(kāi)特定河流線(xiàn)路復(fù)位。該電路還可與其他八進(jìn)制驅(qū)動(dòng)器級(jí)聯(lián)，以阻塞8位多個(gè)數(shù)據(jù)。芯片啟用（CE）時(shí)選擇設(shè)備線(xiàn)路低。另外，（SO）被置于三態(tài)模式取消選擇設(shè)備時(shí)。負(fù)邊緣（CE）傳輸驅(qū)動(dòng)器的電壓電平對(duì)移動(dòng)寄存器和（CE）的積極影響將來(lái)自換檔寄存器的新數(shù)據(jù)鎖存到兩個(gè)驅(qū)動(dòng)器上。當(dāng)CE低時(shí)，數(shù)據(jù)位包含在移位寄存器每數(shù)據(jù)位存在于SI時(shí)的SCLK正躍遷輸入被鎖存到移位寄存器負(fù)遷移。

內(nèi)部塊說(shuō)明

設(shè)備的內(nèi)部架構(gòu)基于三個(gè)內(nèi)部主塊：用于與SPI總線(xiàn)對(duì)話(huà)的八進(jìn)制移位寄存器、寫(xiě)入設(shè)備的控制位的八進(jìn)制鎖和八進(jìn)制加載驅(qū)動(dòng)程序數(shù)組。

移位寄存器

移位寄存器有串行和并行輸入以及串行和并行輸出。串行輸入ac接收來(lái)自SPIBUS的數(shù)據(jù)，串行輸出同時(shí)將數(shù)據(jù)發(fā)送到SPI總線(xiàn)。這個(gè)并行輸出在數(shù)據(jù)傳輸結(jié)束時(shí)鎖存在L9822N的并行鎖存?zhèn)取＿@個(gè)在數(shù)據(jù)傳輸周期開(kāi)始時(shí)，并行輸入卡阻診斷數(shù)據(jù)到換檔寄存器。

平行閂鎖

并行鎖存器保存來(lái)自移位的輸入數(shù)據(jù)注冊(cè)。然后這些數(shù)據(jù)驅(qū)動(dòng)輸出級(jí)。鎖存器中的單個(gè)寄存器可以通過(guò)以保護(hù)過(guò)載的故障條件輸出階段。整個(gè)鎖閂也被清除了通過(guò)復(fù)位信號(hào)。

輸出級(jí)

輸出級(jí)提供主動(dòng)低驅(qū)動(dòng)信號(hào)適用于0.75A連續(xù)負(fù)載。輸出將內(nèi)部齊納設(shè)置為36伏，以便在關(guān)閉時(shí)鉗制感應(yīng)瞬變。每個(gè)輸出還具有電壓比較器B服務(wù)于OutputNode。如果這個(gè)on輸出引腳上的電壓超過(guò)1.8V，即故障假設(shè)條件，驅(qū)動(dòng)該特定級(jí)的閂鎖復(fù)位，將輸出關(guān)閉以保護(hù)它。此操作的時(shí)間安排如下所述。這些比較器還向移位寄存器。另外，com  parators包含一個(gè)內(nèi)部下拉電流將導(dǎo)致電池指示低輸出電壓，如果輸出編程為關(guān)閉，輸出引腳開(kāi)路。定時(shí)數(shù)據(jù)傳輸圖2顯示了使用SPI總線(xiàn)。CE高-低過(guò)渡當(dāng)芯片啟用（CE）引腳為拉低。Thetri-stateSerialOutput（SO）引腳驅(qū)動(dòng)程序?qū)⑹笴E較低的時(shí)間成為可能。在CE引腳的邊緣，診斷數(shù)據(jù)來(lái)自輸出級(jí)中的電壓比較器將接入移位寄存器。如果特定輸出是高，一個(gè)邏輯信號(hào)會(huì)被塞進(jìn)移位寄存器。如果輸出低，邏輯零將在這里裝的最重要的位（07）應(yīng)該是顯示串行輸入（SI）引腳。一個(gè)零引腳將編程一個(gè)輸出，而一個(gè)將編程輸出關(guān)閉。

SCLK躍遷

然后應(yīng)拔出串行時(shí)鐘（SCLK）引腳高。在這一點(diǎn)上，來(lái)自最重要輸出（07）的診斷位將出現(xiàn)在最高點(diǎn)這里表示07針腳高于1.8V。然后將SCLK引腳調(diào)低至高。新的SO數(shù)據(jù)將出現(xiàn)在每個(gè)邊緣之后的SCLK和新的SI數(shù)據(jù)將被鎖存到下降沿上的L9822N移位寄存器。無(wú)限制的數(shù)據(jù)量可以通過(guò)e-viceshift寄存器（輸入SI pin和輸出該pin）進(jìn)行移位，允許其他SPI設(shè)備級(jí)聯(lián)到帶L9822N的菊花鏈。

CE低到高轉(zhuǎn)變

一旦將數(shù)據(jù)移到最后一位L9822NSP，CE銷(xiāo)應(yīng)拉高。在CE的上升沿，移位寄存器數(shù)據(jù)是橫向的，輸出級(jí)將由新數(shù)據(jù)驅(qū)動(dòng)。內(nèi)部160μs延遲定時(shí)器也將在該上升沿啟動(dòng)（參見(jiàn)圖德）。在160μs期間，輸出將為僅由模擬限流電路保護(hù)由于故障導(dǎo)致平行鎖存復(fù)位條件它持續(xù)了一段時(shí)間。這個(gè)降低部件，以克服高涌流打開(kāi)后可能立即流動(dòng)。一旦延遲時(shí)間已過(guò)，輸出電壓為通過(guò)比較器和任何體積大于1.8的輸出進(jìn)行感應(yīng)瓦雷拉切多夫，應(yīng)該是注意，SCLK引腳在CE引腳的兩個(gè)傳輸位置都應(yīng)較低，以避免換檔注冊(cè)。TheSCLKinputis由行政長(zhǎng)官接手使SCLK引腳在CE引腳高。

故障條件檢查

可以用以下方法檢查故障情況。輸入新的控制字節(jié)。等等160微秒左右，以使輸出穩(wěn)定下來(lái)。在同一個(gè)控制器上計(jì)時(shí)，并觀察設(shè)備輸出的診斷數(shù)據(jù)。診斷位應(yīng)與第一次打卡。任何不同之處都會(huì)指向錯(cuò)誤打開(kāi)輸出。如果輸出由計(jì)時(shí)為0，1作為輸出的直徑，輸出pin仍然很高并且存在短路或過(guò)載情況。如果輸入1時(shí)，輸出被編程關(guān)閉，一個(gè)零作為診斷的依據(jù)回來(lái)了輸出，沒(méi)有把輸出引腳拉高必須是浮動(dòng)的，因此存在開(kāi)路情況對(duì)于那個(gè)輸出。

圖1:AsynchronousReset的字節(jié)計(jì)時(shí)。

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